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如何在擁擠的電路板上實現(xiàn)低EMI的高效電源設計?
亞德諾
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作者:ADI公司   Bhakti Waghmare和Diarmuid Carey

有限且不斷縮小的電路板空間、緊張的設計周期以及嚴格的電磁干擾(EMI)規(guī)范(例如CISPR 32和CISPR 25)這些限制因素,都導致獲得具有高效率和良好熱性能電源的難度很大。在整個設計周期中,電源設計通;咎幱谠O計過程的最后階段,設計人員需要努力將復雜的電源擠進更緊湊的空間,這使問題變得更加復雜,非常令人沮喪。為了按時完成設計,只能在性能方面做些讓步,把問題丟給測試和驗證環(huán)節(jié)去處理。簡單、高性能和解決方案尺寸三個考慮因素通常相互沖突:只能優(yōu)先考慮一兩個,而放棄第三個,尤其當設計期限臨近時。犧牲一些性能變得司空見慣;其實不應該是這樣的。

本文首先概述了在復雜的電子系統(tǒng)中電源帶來的嚴重問題:即EMI,通常簡稱為噪聲。電源會產(chǎn)生EMI,必須加以解決,那么問題的根源是什么?通常有何緩解措施?本文介紹減少EMI的策略,提出了一種解決方案,能夠減少EMI、保持效率,并將電源放入有限的解決方案空間中。


 

狀 態(tài): 離線

公司簡介
產(chǎn)品目錄

公司名稱: 亞德諾
聯(lián) 系 人: 曹赟
電  話: 0755-82823086
傳  真:
地  址: 福田區(qū)濱河路國通大廈
郵  編: 518048
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